一种减小正码速调整等候抖动的新方法

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一种减小正码速调整等候抖动的新方法

更新时间：2024-10-14

- 一种减小正码速调整等候抖动的新方法
- Issue 1, Pages: 45-51(1992)
- 作者机构：
  
  清华大学
- 作者简介：
- 基金信息：
- DOI：
  CLC：
- Published：1992
- 稿件说明：
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[1]曾烈光,冯重熙.一种减小正码速调整等候抖动的新方法[J].通信学报,1992(01):45-51.

[J]. 1992, (1): 45-51.
[1]曾烈光,冯重熙.一种减小正码速调整等候抖动的新方法[J].通信学报,1992(01):45-51. DOI：

[J]. 1992, (1): 45-51. DOI：

摘要

本文提出一种能够明显减小正码速调整等候抖动的新方法——分离塞入比法。采用此方法的超大规模专用集成电路已在日本制成。本文简介这种方法提出的背景、原理、实验结果及应用特点。

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