线速路由器分组并行处理体系结构与性能分析

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线速路由器分组并行处理体系结构与性能分析

更新时间：2024-10-14

- 线速路由器分组并行处理体系结构与性能分析
- Issue 8, Pages: 52-57(2000)
- 作者机构：
  
  解放军理工大学通信工程学院交换技术与ATM研究中心!江苏南京210016
- 作者简介：
- 基金信息：
- DOI：
  CLC： TN915
- Published：2000
- 稿件说明：
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[1]田畅,王海,郑少仁.线速路由器分组并行处理体系结构与性能分析[J].通信学报,2000(08):52-57.

[J]. 2000, (8): 52-57.
[1]田畅,王海,郑少仁.线速路由器分组并行处理体系结构与性能分析[J].通信学报,2000(08):52-57. DOI：

[J]. 2000, (8): 52-57. DOI：

摘要

本文在分析路由器报文处理需求的基础上

探讨了报文多处理模块并行处理的体系结构

并以四个处理模块为例对分组处理时延做了定量分析和仿真。分析表明

当各模块处理能力总和与单处理模块结构处理能力相同时

多模块结构处理时延将大于单模块结构 ;当各模块处理能力总和大于单处理模块结构处理能力两倍时

系统处理的时延特性可得到明显改善

并且系统具有较好的可扩充性。

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